Cadence與GLOBALFOUNDRIES攜手改善20/14奈米DFM流程

來源： eettaiwan 發布者：eettaiwan.

熱度0票 時間：2013年5月09日 05:39

益華電腦宣布，晶圓代工業者格羅方德半導體與該公司合作，為 20奈米與 14奈米製程提供樣式分析資料。

GLOBALFOUNDRIES運用Cadence樣式分類與樣式比對解決方案，因為他們能夠使可製造性設計加速達4倍，而這正是提升客戶晶片良率與生產力的關鍵所在。

「我們整合了Cadence分類技術，依據包括不精確樣式等樣式類似性，按照樣式種類來分類良率負面因子，使稱為DRC+的樣式比對式微影signoff流程效率臻於極致。

」GLOBALFOUNDRIES DFM部門的Fellow兼資深協理Luigi Capodieci表示：「創新DRC+ signoff流程運用在好幾項32與28奈米量產IC設計上一直都很成功，我們甚至還運用到當今最先進的製程幾何中。

」

Cadence樣式分類技術讓GLOBALFOUNDRIES能夠分類成千上萬良率負面因子、製程熱點與晶片故障，納入方便實用的樣式庫中。

Cadence樣式搜尋與比對分析嵌入在Cadence Litho Physical Analyzer、實體驗證系統與一致化的 Virtuoso 客制/類比以及 Encounter 數位設計實現系統解決方案中，能為 GLOBALFOUNDRIES 客戶提供彈性，駕馭Encounter與Virtuoso中的設計中signoff樣式比對與自動修正功能，使全晶片signoff流程的整合達到100%，而且已經成功地運用在先進位程量產晶片上了。

對於運用Cadence設計工具的GLOBALFOUNDRIES客戶而言，通過晶片驗證的DFM流程不僅方便好用，更與Cadence的客制、數位與全晶片signoff流程密切整合。

將樣式比對式DRC+整合到Virtuoso Layout Suite中，實現了威力強大的自動建構校正方法，也實現了先進的不良樣式規避與自動修正功能。

Encounter數位設計實現系統始終如一地正確且快速地找出並修正所有DRC+違反，不會導致額外的DRC或DRC+違反，而且在好幾項28奈米設計中的運用也一直都很成功。

「DFM在晶片開發與製造之間扮演越來越重要的連結角色，而且在晶片良率與可預測性方面擔負重要的角色。

」Cadence晶片實現事業群資深副總裁徐季平表示：「Cadence樣式分類技術幫助GLOBALFOUNDRIES客戶制定和達成高水準的良率目標，確保能夠享受到複雜設計的最高投資報酬。

我們非常感激GLOBALFOUNDRIES承諾，將本公司技術運用於20與14奈米和以下的製程。

」